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Um processador RISC é implementado com um pipeline de 5 estágios. Os estágios da versão pipeline são: (1) busca de instrução, (2) busca de operandos, (3) execução da operação, (4) acesso à memória e (5) atualização do banco de registradores. A frequência máxima de operação é de 400 MHz. O tempo que um programa leva para executar 200 instruções considerando não apresenta nenhum conflito de dados ou de controle entre instruções é de:
